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XC4036XLA-09HQ240I_xilinx解决方案本文导读：为了简单起见，我们只考虑图1所示SOC中的少量重要元件。DUT由x86处理器、主 桥(Host Bridge)、SDRAM控制器和PCI桥组成。在验证环境中，为了提真速度，可以把x86处理器看作是一个BFM，同时提供某种PCI从模型。简 单地说，x8BFM具有某种形式的读/写命令，能产生总线周期，因此设计可以运行起来。

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标志组管理。标志组是一个数据结构，采用FPGA的片内寄存器实现，每个占bit。任务或中断服务可以将某一位置位或复位。当任务所需要的发生时，则将相应的位置位；当任务所等待的都发生时，则应向控制器提出改变任务状态的相应申请，，同时将任务的ID号送给任务管理模块。信号量管理。信号量由2部分组成：1bit的无符号整型的计数值（等待该信号量的任务组成的等待任务表。

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XC4036XLA-09HQ240I_xilinx解决方案若相同，则输出任务的ID号，否则输出后将所有比较器PRI_COMP的输出做或运算，即得到处于就绪态的优先级高任务的ID号。假设在某一时刻，系统中优先级PRI为和7的任务处于就绪态，对应任务的ID号分别是和11则调度器中的数据处理流程如图5所示。仿真及实验结果整个设计采用VHDL硬件语言描述。为了验证该硬件实现的正确性和高效性。

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